Rétro-ingénierie des MCU Microchip

Microchip Technology est un fabricant américain de microcontrôleurs, mémoires et semi-conducteurs analogiques. Ses produits incluent des microcontrôleurs (PICmicro, dsPIC / PIC24, PIC32), des EEPROM série, des SRAM série, des dispositifs KEELOQ, des circuits RF, des circuits de gestion thermique, de puissance et de batterie, ainsi que des dispositifs linéaires, d'interface et mixtes. Certains des périphériques d'interface incluent USB, ZigBee/MiWi, CAN et Ethernet.

Le siège social est situé à Chandler, Arizona, avec des usines de fabrication de tranches à Tempe, Arizona et Gresham, Oregon. Les ventes pour l'exercice clos le 31 mars 2013 étaient de 1 581 623 000 $.

 

 

Série Microchip PIC

PIC est une famille de microcontrôleurs à architecture Harvard modifiée, fabriqués par Microchip Technology, dérivés du PIC1650 développé à l'origine par la division Microelectronics de General Instrument. Le nom PIC faisait initialement référence à "Peripheral Interface Controller".

Les PIC sont populaires auprès des développeurs industriels et des amateurs en raison de leur faible coût, de leur large disponibilité, de leur large base d'utilisateurs, de leur vaste collection de notes d'application, de la disponibilité d'outils de développement peu coûteux ou gratuits, et de leur capacité de programmation série (et de reprogrammation avec la mémoire flash). Ils sont également couramment utilisés dans l'enseignement de la programmation car ils sont souvent livrés avec le logiciel 'pic logicator' facile à utiliser.

Historique

Le PIC original a été construit pour être utilisé avec le nouveau CPU 16 bits de General Instrument, le CP1600. Bien que généralement un bon CPU, le CP1600 avait de faibles performances d'E/S, et le PIC 8 bits a été développé en 1975 pour améliorer les performances de l'ensemble du système en déchargeant les tâches d'E/S du CPU. Le PIC utilisait un microcode simple stocké en ROM pour effectuer ses tâches, et bien que le terme ne soit pas utilisé à l'époque, il partage certaines caractéristiques communes avec les conceptions RISC.

En 1985, General Instrument a cédé sa division microélectronique et la nouvelle direction a lu l'EEPROM et la ROM, la mémoire flash, annulé la lecture du HEX protégé - presque tout ce qui était à ce moment-là obsolète. Cependant, le PIC a été amélioré avec une EPROM interne pour produire un contrôleur de canal programmable et aujourd'hui une grande variété de PIC sont disponibles avec divers périphériques embarqués (modules de communication série, UART, noyaux de contrôle moteur, etc.) et une mémoire programme allant de 256 mots à 64k mots et plus (un "mot" correspond à une instruction en langage assembleur, variant de 12, 14 ou 16 bits selon la famille de PIC).

PIC et PICmicro sont des marques déposées de Microchip Technology. On pense généralement que PIC signifie Peripheral Interface Controller, bien que le sigle original de General Instruments pour les premiers dispositifs PIC1640 et PIC1650 était "Programmable Interface Controller". L'acronyme a rapidement été remplacé par "Programmable Intelligent Computer".

Le Microchip 16C84 (PIC16x84), introduit en 1993, a été le premier CPU Microchip avec une mémoire EEPROM intégrée. Cette mémoire électriquement effaçable l'a rendu moins cher que les CPU nécessitant une fenêtre de quartz pour effacer l'EPROM.

Architecture du cœur

L'architecture PIC se caractérise par ses multiples attributs :

Espaces de code et de données séparés (architecture Harvard).
Un petit nombre d'instructions de longueur fixe
La plupart des instructions s'exécutent en un cycle (2 cycles d'horloge, ou 4 cycles pour les modèles 8 bits), avec un cycle de délai pour les branchements et les sauts
Un accumulateur (W0), dont l'utilisation (comme opérande source) est implicite (non codée dans l'opcode)
Tous les emplacements RAM fonctionnent comme des registres, à la fois source et/ou destination des opérations mathématiques et autres.
Une pile matérielle pour stocker les adresses de retour
Un espace de données adressable réduit (32, 128 ou 256 octets, selon la famille), étendu par banc de mémoire
Les registres CPU, ports et périphériques sont mappés dans l'espace de données
Les indicateurs d'état de l'ALU sont mappés dans l'espace de données
Le compteur programme est également mappé dans l'espace de données et accessible en écriture (utilisé pour les sauts indirects).
Il n'y a pas de distinction entre l'espace mémoire et l'espace registre car la RAM sert à la fois de mémoire et de registres, et la RAM est généralement simplement appelée fichier de registres ou registres.

 

Espace de données (RAM)

Les PIC disposent d'un ensemble de registres qui servent de RAM générale. Des registres de contrôle spécialisés pour les ressources matérielles intégrées sont également mappés dans l'espace de données. L'adressabilité de la mémoire varie selon les séries de dispositifs, et tous les PIC disposent d'un mécanisme de banc pour étendre l'adressage à une mémoire supplémentaire. Les séries plus récentes disposent d'instructions de déplacement qui peuvent couvrir tout l'espace adressable, indépendamment du banc sélectionné. Dans les dispositifs plus anciens, tout déplacement de registre devait passer par l'accumulateur.

Pour implémenter l'adressage indirect, un "registre de sélection de fichier" (FSR) et un "registre indirect" (INDF) sont utilisés. Un numéro de registre est écrit dans le FSR, après quoi les lectures ou écritures dans INDF se feront réellement vers ou depuis le registre pointé par FSR. Les dispositifs plus récents ont étendu ce concept avec des incréments/décréments pré et post pour une plus grande efficacité lors de l'accès à des données stockées séquentiellement. Cela permet également de traiter FSR presque comme un pointeur de pile (SP).

La mémoire de données externe n'est pas directement adressable, sauf dans certains dispositifs PIC18 à haut nombre de broches.

Espace de code

L'espace de code est généralement implémenté en ROM, EPROM ou flash ROM. En général, la mémoire de code externe n'est pas directement adressable en raison de l'absence d'interface mémoire externe. Les exceptions sont les PIC17 et certains dispositifs PIC18 à haut nombre de broches.

 

Taille de mot

Tous les PIC manipulent (et adressent) les données en blocs de 8 bits. Cependant, l'unité d'adressabilité de l'espace code n'est généralement pas la même que celle de l'espace de données. Par exemple, les PIC des familles baseline (PIC12) et mid-range (PIC16) ont une mémoire programme adressable avec la même taille de mot que la largeur d'instruction, soit 12 ou 14 bits respectivement. En revanche, dans la série PIC18, la mémoire programme est adressée en incréments de 8 bits (octets), ce qui diffère de la largeur d'instruction de 16 bits.

Pour être clair, la capacité de la mémoire programme est généralement indiquée en nombre d'instructions (mots simples), plutôt qu'en octets.

Piles

Les PIC disposent d'une pile d'appels matérielle, utilisée pour sauvegarder les adresses de retour. La pile matérielle n'est pas accessible par logiciel sur les dispositifs plus anciens, mais cela a changé avec les dispositifs de la série 18.

Le support matériel pour une pile de paramètres à usage général était absent dans les premières séries, mais cela a été considérablement amélioré dans la série 18, rendant l'architecture de la série 18 plus adaptée aux compilateurs de haut niveau.

Jeu d'instructions

Les instructions d'un PIC varient d'environ 35 instructions pour les PIC bas de gamme à plus de 80 instructions pour les PIC haut de gamme. Le jeu d'instructions comprend des instructions pour effectuer diverses opérations sur les registres directement, l'accumulateur et une constante littérale, ou l'accumulateur et un registre, ainsi que pour l'exécution conditionnelle et les branchements.

Certaines opérations, comme la mise à zéro et le test de bits, peuvent être effectuées sur n'importe quel registre numéroté, mais les opérations arithmétiques à deux opérandes impliquent toujours W (l'accumulateur), écrivant le résultat soit dans W, soit dans l'autre registre opérande. Pour charger une constante, il est nécessaire de la charger dans W avant de pouvoir la déplacer vers un autre registre. Sur les cœurs plus anciens, tous les déplacements de registre devaient passer par W, mais cela a changé sur les cœurs "haut de gamme".

Les cœurs PIC disposent d'instructions de saut qui sont utilisées pour l'exécution conditionnelle et les branchements. Les instructions de saut sont 'sauter si bit est à 1' et 'sauter si bit est à 0'. Parce que les cœurs antérieurs au PIC18 n'avaient que des instructions de branchement inconditionnel, les sauts conditionnels sont implémentés par un saut conditionnel (avec la condition opposée) suivi d'un branchement inconditionnel. Les sauts sont également utiles pour l'exécution conditionnelle de toute instruction suivante immédiate. Il est possible de sauter des instructions de saut. Par exemple, la séquence d'instructions "sauter si A; sauter si B; C" exécutera C si A est vrai ou si B est faux.

La série 18 a implémenté des registres fantômes qui sauvegardent plusieurs registres importants lors d'une interruption, fournissant un support matériel pour sauvegarder automatiquement l'état du processeur lors du traitement des interruptions.

En général, les instructions PIC se répartissent en 5 classes :

Opération sur le registre de travail (WREG) avec un opérande immédiat 8 bits ("littéral"). Par exemple, movlw (déplacer le littéral dans WREG), andlw (ET littéral avec WREG). Une instruction particulière au PIC est retlw, charger immédiat dans WREG et retourner, qui est utilisée avec des branchements calculés pour créer des tables de recherche.
Opération avec WREG et un registre indexé. Le résultat peut être écrit soit dans le registre de travail (par ex. addwf reg,w), soit dans le registre sélectionné (par ex. addwf reg,f).
Opérations sur les bits. Elles prennent un numéro de registre et un numéro de bit, et effectuent l'une des 4 actions : mettre à 1 ou à 0 un bit, et tester et sauter sur mise à 1/à 0. Ces dernières sont utilisées pour réaliser des branchements conditionnels. Les indicateurs d'état habituels de l'ALU sont disponibles dans un registre numéroté, de sorte que des opérations telles que "brancher si retenue claire" sont possibles.
Transferts de contrôle. En dehors des instructions de saut mentionnées précédemment, il n'y en a que deux : goto et call.
Quelques instructions diverses à zéro opérande, comme le retour de sous-routine, et sleep pour passer en mode basse consommation.
Performances : Les décisions architecturales visent à maximiser le rapport vitesse/coût. L'architecture PIC a été parmi les premières conceptions de CPU scalaires, et est encore parmi les plus simples et les moins chères. L'architecture Harvard - dans laquelle les instructions et les données proviennent de sources séparées - simplifie grandement le timing et la conception des microcircuits, ce qui profite à la vitesse d'horloge, au prix et à la consommation d'énergie.

Le jeu d'instructions PIC est adapté à l'implémentation de tables de recherche rapides dans l'espace programme. De telles recherches prennent une instruction et deux cycles. De nombreuses fonctions peuvent être modélisées de cette manière. L'optimisation est facilitée par l'espace programme relativement important du PIC (par exemple 4096 × 14 bits sur le 16F690) et par la conception du jeu d'instructions, qui permet des constantes intégrées. Par exemple, la cible d'une instruction de branchement peut être indexée par W, et exécuter un "RETLW" qui fait ce que son nom indique - retourner avec un littéral dans W.

La latence d'interruption est constante à trois cycles d'instruction. Les interruptions externes doivent être synchronisées avec le cycle d'instruction de quatre horloges, sinon il peut y avoir une gigue d'un cycle d'instruction. Les interruptions internes sont déjà synchronisées. La latence d'interruption constante permet aux PIC d'atteindre des séquences de timing à faible gigue pilotées par interruption. Un exemple est un générateur d'impulsions de synchronisation vidéo. Ce n'est plus vrai dans les derniers modèles PIC, car ils ont une latence d'interruption synchrone de trois ou quatre cycles.

Avantages

Petit jeu d'instructions à apprendre
Architecture RISC
Oscillateur intégré avec vitesses sélectionnables
Facilité d'accès, programmation en circuit et débogage en circuit - les unités PICKit sont disponibles pour moins de 50 $
Microcontrôleurs peu coûteux
Large gamme d'interfaces incluant I²C, SPI, USB, USART, A/N, comparateurs programmables, PWM, LIN, CAN, PSP, et Ethernet
Disponibilité de processeurs en boîtier DIL les rendant faciles à manipuler pour un usage amateur.
Limitations : Un accumulateur
Le changement de banc de registres est nécessaire pour accéder à toute la RAM de nombreux dispositifs
Les opérations et les registres ne sont pas orthogonaux ; certaines instructions peuvent adresser la RAM et/ou des constantes immédiates, tandis que d'autres ne peuvent utiliser que l'accumulateur
Les limitations de la pile suivantes ont été corrigées dans la série PIC18, mais s'appliquent toujours aux cœurs antérieurs :

La pile d'appels matérielle n'est pas adressable, donc la commutation préemptive de tâches ne peut pas être implémentée
Les piles implémentées par logiciel ne sont pas efficaces, ce qui rend difficile la génération de code réentrant et le support des variables locales
Avec une mémoire programme paginée, il y a deux tailles de page à gérer : une pour CALL et GOTO, et une autre pour GOTO calculé (généralement utilisé pour les tables de recherche). Par exemple, sur PIC16, CALL et GOTO ont 11 bits d'adressage, donc la taille de page est de 2048 mots d'instruction. Pour les GOTO calculés, où l'on ajoute à PCL, la taille de page est de 256 mots d'instruction. Dans les deux cas, les bits d'adresse supérieurs sont fournis par le registre PCLATH. Ce registre doit être modifié chaque fois que le contrôle passe d'une page à l'autre. PCLATH doit également être préservé par tout gestionnaire d'interruption.

 

Développement de compilateurs

Bien que plusieurs compilateurs commerciaux soient disponibles, en 2008, Microchip a publié ses propres compilateurs C, C18 et C30, pour les gammes de processeurs 18F, 24F et 30/33F.

Le jeu d'instructions RISC facile à apprendre du langage assembleur PIC peut rendre le flux global difficile à comprendre. L'utilisation judicieuse de macros simples peut améliorer la lisibilité du langage assembleur PIC. Par exemple, l'assembleur PIC original de Parallax ("SPASM") a des macros qui cachent W et font ressembler le PIC à une machine à deux adresses. Il a des instructions macro comme "mov b, a" (déplacer les données de l'adresse a vers l'adresse b) et "add b, a" (ajouter les données de l'adresse a aux données de l'adresse b). Il cache également les instructions de saut en fournissant des instructions macro de branchement à trois opérandes telles que "cjne a, b, dest" (comparer a avec b et sauter à dest s'ils ne sont pas égaux).

 

Différences architecturales des cœurs de famille

Les puces PICmicro ont une architecture Harvard, et les mots d'instruction ont des tailles inhabituelles. À l'origine, les instructions 12 bits comprenaient 5 bits d'adresse pour spécifier l'opérande mémoire et des destinations de branchement sur 9 bits. Les révisions ultérieures ont ajouté des bits d'opcode, permettant des bits d'adresse supplémentaires.

Dispositifs à cœur baseline (12 bits). Ces dispositifs disposent d'une mémoire code de 12 bits de large, d'un fichier de registres de 32 octets et d'une pile d'appels à deux niveaux très petite. Ils sont représentés par la série PIC10, ainsi que par certains PIC12 et PIC16. Les dispositifs baseline sont disponibles dans des boîtiers de 6 à 40 broches.

Généralement, les 7 à 9 premiers octets du fichier de registres sont des registres spéciaux, et les octets restants sont de la RAM générale. Les pointeurs sont implémentés à l'aide d'une paire de registres : après avoir écrit une adresse dans le FSR (registre de sélection de fichier), le registre INDF (fichier indirect) devient un alias du registre adressé. Si une RAM en banc est implémentée, le numéro de banc est sélectionné par les 3 bits de poids fort du FSR. Cela affecte les numéros de registre 16 à 31 ; les registres 0 à 15 sont globaux et non affectés par les bits de sélection de banc.

En raison de l'espace de registre très limité (5 bits), 4 registres rarement lus n'ont pas reçu d'adresse, mais ont été écrits par des instructions spéciales (OPTION et TRIS).

L'espace d'adressage ROM est de 512 mots (12 bits chacun), pouvant être étendu à 2048 mots par banc. Les instructions CALL et GOTO spécifient les 9 bits de poids faible de la nouvelle position du code ; les bits de poids fort supplémentaires sont pris dans le registre d'état. Notez qu'une instruction CALL ne comprend que 8 bits d'adresse et ne peut spécifier que des adresses dans la première moitié de chaque page de 512 mots.

Les tables de recherche sont implémentées à l'aide d'un GOTO calculé (affectation au registre PCL) vers une table d'instructions RETLW.

Le jeu d'instructions est le suivant. Les numéros de registre sont appelés "f", tandis que les constantes sont appelées "k". Les numéros de bit (0-7) sont sélectionnés par "b". Le bit "d" sélectionne la destination : 0 indique W, tandis que 1 indique que le résultat est réécrit dans le registre source f. Les indicateurs C et Z peuvent être mis à jour en fonction du résultat ; sinon, ils ne sont pas modifiés. Les instructions d'addition et de soustraction (mais pas de rotation) qui mettent à jour C mettent également à jour l'indicateur DC (retenue numérique), la retenue du bit 3 au bit 4, utile pour l'arithmétique BCD.

Même opcode que le PIC 12 bits
† : Instruction unique au jeu d'instructions EM78 sans équivalent PIC

Certains modèles prennent en charge plusieurs bancs de ROM ou RAM, de la même manière que les autres microcontrôleurs PIC.

Dispositifs à cœur mid-range (14 bits)

Ces dispositifs disposent d'une mémoire code de 14 bits de large et d'une pile d'appels améliorée à 8 niveaux. Le jeu d'instructions diffère très peu des dispositifs baseline, mais les 2 bits d'opcode supplémentaires permettent d'adresser directement 128 registres et 2048 mots de code. Il y a quelques instructions supplémentaires diverses, et deux instructions littérales 8 bits supplémentaires, add et subtract. Le cœur mid-range est disponible dans la majorité des dispositifs étiquetés PIC12 et PIC16.

Les 32 premiers octets de l'espace de registres sont alloués aux registres spéciaux ; les 96 octets restants sont utilisés pour la RAM générale. Si une RAM en banc est utilisée, les 16 registres supérieurs (0x70-0x7F) sont globaux, ainsi que quelques-uns des registres spéciaux les plus importants, y compris le registre STATUS qui contient les bits de sélection de banc RAM. (Les autres registres globaux sont FSR et INDF, les 8 bits de poids faible du compteur programme PCL, le registre de préchargement PC haut PCLATH, et le registre de contrôle maître des interruptions INTCON.)

Le registre PCLATH fournit les bits d'adresse d'instruction de poids fort lorsque les 8 bits fournis par une écriture dans le registre PCL, ou les 11 bits fournis par une instruction GOTO ou CALL, ne sont pas suffisants pour adresser l'espace ROM disponible.

Dispositifs à cœur mid-range amélioré (14 bits)

Les dispositifs à cœur mid-range amélioré introduisent une pile matérielle plus profonde, des méthodes de réinitialisation supplémentaires, 14 instructions supplémentaires et des optimisations pour le langage C. En particulier, il y a deux registres INDF (INDF0 et INDF1) et deux paires de registres FSR correspondantes (FSRnL et FSRnH). Des instructions spéciales utilisent les registres FSRn comme des registres d'adresse, avec diverses modes d'adressage.

Instructions supplémentaires PIC 14 bits amélioré

13	12	11	10	9	8	7	6	5	4	3	2	1	0	Mnémonique	C?	Z?	Description
0	0	0	0	0	0	0	opcode							Instructions diverses
0	0	0	0	0	0	0	0	0	0	0	0	0	1	RESET			Réinitialisation logicielle
0	0	0	0	0	0	0	0	0	0	1	0	1	0	CALLW			Pousser PC, puis sauter vers PCLATH:W
0	0	0	0	0	0	0	0	0	0	1	0	1	1	BRW			PC ← PC + W, saut relatif utilisant W
0	0	0	0	0	0	0	0	0	1	0	n	0	0	MOVIW ++FSRn		Z	Incrémenter FSRn, puis W ← INDFn
0	0	0	0	0	0	0	0	0	1	0	n	0	1	MOVIW −−FSRn		Z	Décrémenter FSRn, puis W ← INDFn
0	0	0	0	0	0	0	0	0	1	0	n	1	0	MOVIW FSRn++		Z	W ← INDFn, puis incrémenter FSRn
0	0	0	0	0	0	0	0	0	1	0	n	1	1	MOVIW FSRn−−		Z	W ← INDFn, puis décrémenter FSRn
0	0	0	0	0	0	0	0	0	1	1	n	m		MOVWI utilisant FSRn			INDFn ← W, mêmes modes que MOVIW
0	0	0	0	0	0	0	0	1	k					MOVLB k			BSR ← k, déplacer le littéral vers le registre de sélection de banc
1	1	opcode				d	registre							Opérations ALU : dest ← OP(f,W)
1	1	0	1	0	1	d	f							LSLF f,d	C	Z	dest ← f << 1, décalage logique à gauche
1	1	0	1	1	0	d	f							LSRF f,d	C	Z	dest ← f >> 1, décalage logique à droite
1	1	0	1	1	1	d	f							ASRF f,d	C	Z	dest ← f >> 1, décalage arithmétique à droite
1	1	1	0	1	1	d	f							SUBWFB f,d	C	Z	dest ← f + ~W + C, soustraction avec retenue
1	1	1	1	0	1	d	f							ADDWFC f,d	C	Z	dest ← f + W + C, addition avec retenue
1	1	opcode				k								Opérations avec littéral k
1	1	0	0	0	1	0	n	k						ADDFSR FSRn,k			FSRn ← FSRn + k, ajouter un décalage signé de 6 bits
1	1	0	0	0	1	1	k							MOVLP k			PCLATH ← k, déplacer un littéral de 7 bits vers le verrou PC haut
1	1	0	0	1	k									BRA k			PC ← PC + k, branchement relatif utilisant un décalage signé de 9 bits
1	1	1	1	1	1	0	n	k						MOVIW k[FSRn]		Z	W ← [FSRn+k], décalage signé de 6 bits
1	1	1	1	1	1	1	n	k						MOVWI k[FSRn]			[FSRn+k] ← W, décalage signé de 6 bits
13	12	11	10	9	8	7	6	5	4	3	2	1	0	Mnémonique	C?	Z?	Description

Dispositifs à cœur haut de gamme PIC17 (16 bits)

La série 17 n'a jamais été très populaire et a été remplacée par l'architecture PIC18. Elle n'est pas recommandée pour les nouvelles conceptions, et sa disponibilité peut être limitée.

Les améliorations par rapport aux cœurs antérieurs sont des opcodes de 16 bits (permettant de nombreuses nouvelles instructions) et une pile d'appels à 16 niveaux. Les dispositifs PIC17 étaient produits dans des boîtiers de 40 à 68 broches.

La série 17 a introduit un certain nombre de nouvelles fonctionnalités importantes :

un accumulateur mappé en mémoire
un accès en lecture à la mémoire code (lectures de table)
des déplacements directs de registre à registre (les cœurs antérieurs devaient passer par l'accumulateur)
une interface mémoire programme externe pour étendre l'espace code
un multiplicateur matériel 8 × 8 bits
une deuxième paire de registres indirects
un incrément/décrément automatique contrôlé par des bits dans un registre d'état (ALUSTA)
Dispositifs à cœur haut de gamme PIC18 (16 bits). Microchip a introduit l'architecture PIC18 en 2000. Contrairement à la série 17, elle s'est avérée très populaire, avec un grand nombre de variantes actuellement en fabrication. Par rapport aux dispositifs antérieurs, qui étaient plus souvent programmés en assembleur, C est devenu le langage de développement prédominant.

La série 18 hérite de la plupart des fonctionnalités et instructions de la série 17, tout en ajoutant un certain nombre de nouvelles fonctionnalités importantes :

la pile d'appels est large de 21 bits et beaucoup plus profonde (31 niveaux)
la pile d'appels peut être lue et écrite (registres TOSU:TOSH:TOSL)
des instructions de branchement conditionnel
un mode d'adressage indexé (PLUSW)
l'extension des registres FSR à 12 bits, leur permettant d'adresser linéairement tout l'espace de données
l'ajout d'un autre registre FSR (portant le nombre à 3)
L'espace RAM est de 12 bits, adressé à l'aide d'un registre de sélection de banc de 4 bits et d'un décalage de 8 bits dans chaque instruction. Un bit "access" supplémentaire dans chaque instruction sélectionne entre le banc 0 (a=0) et le banc sélectionné par le BSR (a=1).

Une pile à 1 niveau est également disponible pour les registres STATUS, WREG et BSR. Ils sont sauvegardés lors de chaque interruption et peuvent être restaurés au retour. Si les interruptions sont désactivées, ils peuvent également être utilisés lors d'un appel/retour de sous-routine en définissant le bit s (en ajoutant ", FAST" à l'instruction).

La fonction d'incrément/décrément automatique a été améliorée en supprimant les bits de contrôle et en ajoutant quatre nouveaux registres indirects par FSR. Selon le registre de fichier indirect auquel on accède, il est possible de post-décrémenter, post-incrémenter ou pré-incrémenter FSR, ou de former l'adresse effective en ajoutant W à FSR.

Dans les dispositifs PIC18 plus avancés, un "mode étendu" est disponible, rendant l'adressage encore plus favorable au code compilé :

un nouveau mode d'adressage avec décalage ; certaines adresses qui étaient relatives au banc d'accès sont maintenant interprétées comme relatives au registre FSR2
l'ajout de plusieurs nouvelles instructions, notamment pour manipuler les registres FSR.
Ces changements visaient principalement à améliorer l'efficacité de l'implémentation d'une pile de données. Si FSR2 est utilisé comme pointeur de pile ou pointeur de trame, les éléments de la pile peuvent être facilement indexés, permettant un code réentrant plus efficace. Le compilateur MPLAB C18 de Microchip choisit d'utiliser FSR2 comme pointeur de trame.

Microcontrôleurs 16 bits PIC24 et dsPIC

En 2001, Microchip a introduit la série dsPIC, qui est entrée en production de masse fin 2004. Ce sont les premiers microcontrôleurs 16 bits de Microchip. Les dispositifs PIC24 sont conçus comme des microcontrôleurs généralistes. Les dispositifs dsPIC incluent des capacités de traitement numérique du signal en plus.

Bien que toujours similaires aux architectures PIC antérieures, il y a des améliorations significatives :

Tous les registres sont larges de 16 bits
L'espace d'adressage des données étendu à 64 Ko
Les 2 premiers Ko sont réservés aux registres de contrôle des périphériques
Le changement de banc de données n'est pas nécessaire à moins que la RAM ne dépasse 62 Ko
L'adressage direct "f operand" étendu à 13 bits (8 Ko)
16 registres W disponibles pour les opérations registre-registre.
(Mais les opérations sur les opérandes f font toujours référence à W0.)

Le compteur programme est de 22 bits (Bits 22:1 ; le bit 0 est toujours à 0)
Les instructions sont larges de 24 bits
Les instructions se présentent sous forme octet (B=1) et mot 16 bits (B=0)
La pile est en RAM (avec W15 comme pointeur de pile) ; il n'y a pas de pile matérielle
W14 est le pointeur de trame
Les données stockées en ROM peuvent être accessibles directement ("visibilité de l'espace programme")
Des vecteurs d'interruption pour différentes sources d'interruption sont pris en charge.
Certaines fonctionnalités sont :

MAC matériel (multiplieur-accumulateur)
décalage de barillet
inversion de bits
multiplication 16×16 bits en un cycle et autres opérations DSP
assistance division matérielle (19 cycles pour une division 16/32 bits)
support matériel pour l'indexation de boucle
Accès direct à la mémoire
Les dsPIC peuvent être programmés en C en utilisant le compilateur C30 de Microchip, une variante de GCC.

La ROM d'instructions est large de 24 bits. Le logiciel peut accéder à la ROM en mots de 16 bits, où les mots pairs contiennent les 16 bits de poids faible de chaque instruction, et les mots impairs contiennent les 8 bits de poids fort. La moitié haute des mots impairs se lit comme zéro. Le compteur programme est large de 23 bits, mais le bit de poids faible est toujours à 0, donc il y a 22 bits modifiables.

Les instructions se présentent en deux variétés principales. L'une est comme les instructions PIC classiques, avec une opération entre W0 et une valeur dans un registre f spécifié (c'est-à-dire les 8 premiers Ko de RAM), et un bit de sélection de destination choisissant lequel est mis à jour avec le résultat. Les registres W sont mappés en mémoire, donc l'opérande f peut être n'importe quel registre W.

L'autre forme, nouvelle pour le PIC24, spécifie 3 opérandes de registre W, dont 2 autorisent une spécification de mode d'adressage sur 3 bits :

Le mode d'adressage avec décalage de registre n'est disponible que pour les instructions à 2 opérandes. Les instructions à 3 opérandes utilisent Ww comme seconde source, et utilisent ce codage pour une source immédiate non signée de 5 bits. Notez que le même Ww peut être ajouté à la fois à Wd et Ws.

Quelques instructions font 2 mots de long. Le second mot est un NOP, qui inclut jusqu'à 16 bits supplémentaires d'opérande immédiat.

 

Microcontrôleurs 32 bits PIC32

En novembre 2007, Microchip a introduit la nouvelle famille PIC32MX de microcontrôleurs 32 bits. La gamme initiale est basée sur le cœur MIPS32 M4K standard de l'industrie. Le dispositif peut être programmé en utilisant le compilateur MPLAB C pour PIC32 MCU, une variante du compilateur GCC. Les 18 premiers modèles actuellement en production (PIC32MX3xx et PIC32MX4xx) sont compatibles broche à broche et partagent le même ensemble de périphériques que la famille PIC24FxxGA0xx (16 bits), permettant l'utilisation de bibliothèques, de logiciels et d'outils matériels communs. Aujourd'hui, une gamme complète de microcontrôleurs 32 bits de milieu de gamme est disponible, depuis des boîtiers QFN de 28 broches jusqu'à des dispositifs hautes performances avec Ethernet, CAN et USB OTG.

L'architecture PIC32 apporte un certain nombre de nouvelles fonctionnalités au portefeuille Microchip, notamment :

La vitesse d'exécution la plus élevée : 80 MIPS (120+ Dhrystone MIPS à 80 MHz)
La plus grande mémoire flash : 512 Ko
Une instruction par cycle d'horloge
Le premier processeur avec cache
Permet l'exécution depuis la RAM
Capacités USB Full Speed Host/Dual Role et OTG
Programmation et débogage JTAG et 2 fils complets
Trace en temps réel
Variantes de dispositifs et caractéristiques matérielles. Les dispositifs PIC présentent généralement :

Mode veille (économie d'énergie).
Chien de garde.
Diverses configurations d'oscillateur à cristal ou RC, ou une horloge externe.
Variantes. Au sein d'une série, il existe de nombreuses variantes selon les ressources matérielles de la puce.

Broches d'E/S générales.
Oscillateurs d'horloge internes.
Temporisateurs 8/16/32 bits.
Mémoire EEPROM interne.
Interface série USART synchrone/asynchrone.
Périphérique MSSP pour les communications I²C et SPI.
Modules Capture/Compare et PWM.
Convertisseurs analogique-numérique (jusqu'à ~1,0 MHz).
Support d'interface USB, Ethernet, CAN.
Interface mémoire externe.
Frontaux RF analogiques intégrés (PIC16F639 et rfPIC).
Périphérique de chiffrement à code roulant KEELOQ (codage/décodage).
Et bien d'autres.

Tendances

La première génération de PIC avec mémoire EPROM est presque entièrement remplacée par des puces à mémoire Flash. De même, le jeu d'instructions 12 bits d'origine du PIC1650 et de ses descendants directs a été supplanté par des jeux d'instructions 14 bits et 16 bits. Microchip vend encore des versions OTP (programmables une fois) et à fenêtre (effaçables par UV) de certains de ses PIC à base d'EPROM pour le support d'anciens produits ou les commandes de volume. Le site Web de Microchip indique que les PIC qui ne sont pas électriquement effaçables sont OTP. Des versions à fenêtre UV effaçables de ces puces peuvent être commandées.

Suffixes des numéros de pièce

Le F dans un nom indique généralement que le PICmicro utilise une mémoire flash et peut être effacé électroniquement. À l'inverse, un C signifie généralement qu'il ne peut être effacé qu'en exposant la puce aux rayons ultraviolets (ce qui n'est possible que si un boîtier à fenêtre est utilisé). Une exception à cette règle est le PIC16C84 qui utilise une EEPROM et est donc électriquement effaçable.

Un L dans le nom indique que la pièce fonctionnera à une tension plus basse, souvent avec des limites de fréquence imposées.

Les pièces conçues spécifiquement pour une basse tension, dans une plage stricte de 3 à 3,6 volts, sont marquées d'un J dans le numéro de pièce. Ces pièces sont également uniques en ce qu'elles tolèrent des entrées jusqu'à 5 V.

 

Clones PIC

Des fabricants tiers produisent des produits compatibles, par exemple le Parallax SX.

Outils de développement

Microchip fournit un environnement IDE gratuit appelé MPLAB, qui comprend un assembleur, un éditeur de liens, un simulateur logiciel et un débogueur. Ils vendent également des compilateurs C pour les PIC18 et dsPIC qui s'intègrent proprement à MPLAB. Des versions gratuites pour étudiants des compilateurs C sont également disponibles avec toutes les fonctionnalités. Mais pour les versions gratuites, les optimisations seront désactivées après 60 jours.

Plusieurs tiers proposent des compilateurs C pour les PIC, dont beaucoup s'intègrent à MPLAB ou disposent de leur propre IDE. Un compilateur complet pour le langage PICBASIC pour programmer les microcontrôleurs PIC est disponible chez meLabs, Inc. Mikroelektronika propose des compilateurs PIC en C, Basic et Pascal.

Un langage de programmation graphique, Flowcode, existe capable de programmer des dispositifs PIC 8 et 16 bits et de générer du code C compatible PIC. Il existe en plusieurs versions, d'une démonstration gratuite à une édition professionnelle plus complète.

Le seul compilateur open source pour les familles PIC16 et PIC18 est SDCC. Il utilise GPutils pour les outils d'édition de liens et d'assembleur. Un plugin est nécessaire pour les installer dans MPLAB ou MPLABX.

Des outils de développement sont disponibles pour la famille PIC sous licence GPL ou d'autres licences de logiciels libres ou open source.

Programmateurs de dispositifs

Des dispositifs appelés "programmateurs" sont traditionnellement utilisés pour charger le code programme dans le PIC cible. La plupart des PIC actuellement vendus par Microchip disposent de capacités ICSP (programmation série en circuit) et/ou LVP (programmation basse tension), permettant de programmer le PIC pendant qu'il est dans le circuit cible. La programmation ICSP s'effectue à l'aide de deux broches, horloge et données, tandis qu'une haute tension (12 V) est présente sur la broche Vpp/MCLR. La programmation basse tension évite la haute tension, mais réserve l'usage exclusif d'une broche d'E/S et peut donc être désactivée pour récupérer la broche pour d'autres usages (une fois désactivée, elle ne peut être réactivée qu'en utilisant la programmation haute tension).

Il existe de nombreux programmateurs pour les microcontrôleurs PIC, allant des conceptions extrêmement simples qui reposent sur ICSP pour permettre le téléchargement direct du code depuis un ordinateur hôte, aux programmateurs intelligents capables de vérifier le dispositif à plusieurs tensions d'alimentation. Beaucoup de ces programmateurs complexes utilisent eux-mêmes un PIC préprogrammé pour envoyer les commandes de programmation au PIC à programmer. Le type intelligent de programmateur est nécessaire pour programmer les modèles PIC plus anciens (principalement de type EPROM) qui ne prennent pas en charge la programmation en circuit.

De nombreux PIC à mémoire flash haut de gamme peuvent également s'auto-programmer (écrire dans leur propre mémoire programme). Des cartes de démonstration sont disponibles avec un petit chargeur d'amorçage préprogrammé en usine qui peut être utilisé pour charger des programmes utilisateur via une interface telle que RS-232 ou USB, évitant ainsi le besoin d'un programmateur. Alternativement, un micrologiciel de chargeur d'amorçage est disponible que l'utilisateur peut charger sur le PIC en utilisant ICSP. Les avantages d'un chargeur d'amorçage par rapport à ICSP sont des vitesses de programmation bien supérieures, une exécution immédiate du programme après la programmation, et la possibilité de déboguer et de programmer avec le même câble.

Des programmateurs/débogueurs sont disponibles directement auprès de Microchip. Les programmateurs tiers vont des plans pour construire le vôtre, aux kits d'assemblage, jusqu'aux unités prêtes à l'emploi entièrement testées. Certains sont des conceptions simples qui nécessitent un PC pour effectuer la signalisation de programmation de bas niveau (elles se connectent généralement au port série ou parallèle et consistent en quelques composants simples), tandis que d'autres intègrent la logique de programmation (ils utilisent généralement une connexion série ou USB, sont généralement plus rapides, et sont souvent construits en utilisant des PIC eux-mêmes pour le contrôle).

Clones PICKit 2 et open source

Le PICKit 2 est un programmateur PIC intéressant de Microchip. Il peut programmer tous les PIC et déboguer la plupart des PIC (à partir de mai 2009, seule la famille PIC32 n'est pas prise en charge pour le débogage MPLAB). Depuis ses premières versions, tout le code source (micrologiciel, application PC) et le schéma matériel sont ouverts au public. Cela permet à un utilisateur final de modifier facilement le programmateur pour une utilisation avec un système d'exploitation non Windows tel que Linux ou Mac OS. Parallèlement, cela a également créé beaucoup d'intérêt pour le DIY et des clones. Cette structure open source a apporté de nombreuses fonctionnalités à la communauté PICKit 2, telles que Programmer-to-Go, l'outil UART et l'outil Logic, qui ont été contribués par les utilisateurs de PICKit 2. Les utilisateurs ont également ajouté des fonctionnalités telles que la capacité Programmer-to-Go de 4 Mo, des circuits buck/boost USB, des connecteurs de type RJ12, etc.

 

Débogage

Émulation logicielle

Des émulateurs commerciaux et gratuits existent pour les processeurs de la famille PIC.

Débogage en circuit

Les PIC plus récents disposent d'une interface ICD (débogage en circuit), intégrée au cœur du CPU. Les débogueurs ICD (MPLAB ICD2 et autres tiers) peuvent communiquer avec cette interface en utilisant trois lignes. Ce système de débogage peu coûteux et simple a cependant un prix, à savoir un nombre limité de points d'arrêt (1 sur les PIC plus anciens, 3 sur les plus récents), une perte de certaines E/S (à l'exception de certains PIC à 44 broches en montage en surface qui disposent de broches dédiées au débogage) et une perte de certaines fonctionnalités de la puce. Pour les petits PIC, où la perte d'E/S causée par cette méthode serait inacceptable, des adaptateurs spéciaux sont fabriqués, équipés de PIC avec des broches supplémentaires spécifiquement pour le débogage.

Émulateurs en circuit

Microchip propose trois émulateurs en circuit complets : le MPLAB ICE2000 (interface parallèle, un convertisseur USB est disponible) ; le plus récent MPLAB ICE4000 (connexion USB 2.0) ; et le plus récent, le REAL ICE. Tous ces outils ICE peuvent être utilisés avec l'IDE MPLAB pour le débogage au niveau du code source s'exécutant sur la cible.

L'ICE2000 nécessite des modules d'émulation, et le matériel de test doit fournir un support pouvant accueillir soit un module d'émulation, soit un dispositif de production.

Le REAL ICE se connecte directement aux dispositifs de production prenant en charge l'émulation en circuit via l'interface de programmation PGC/PGD, ou via une connexion haute vitesse utilisant deux broches supplémentaires. Selon Microchip, il prend en charge la "plupart" des processeurs PIC, PIC24 et dsPIC à mémoire flash.

L'ICE4000 n'est plus directement annoncé sur le site Web de Microchip, et la page d'achat indique qu'il n'est pas recommandé pour les nouvelles conceptions.

 

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Questions générales sur l'extraction de firmware de microcontrôleur

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• Est-il sûr d'envoyer un paiement à MikaTech ?

  Si MikaTech était une mauvaise entreprise, vous pourriez trouver des tonnes de mauvaises réputations sur son service sur Internet au cours des 28 années d'histoire

  Donc, la réponse est OUI ! Nous sommes de bonnes personnes.

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• Mikatech peut-elle casser des circuits intégrés non listés sur ce site ?

  Différents fabricants de puces ont des numéros de pièce différents, mais le cœur interne de la puce peut être fabriqué avec la même technologie, il serait tout à fait impossible de lister tous les numéros de pièce auxquels notre technologie peut s'appliquer, tels que MYSON, STK, FEELING, ANALOG, FUJITSU, NOVATEK, LG/HYNDAI.
  
  De plus, grâce à l'avancée de la technologie, chaque jour nous acquérons plus d'expérience et développons de nouvelles méthodes de rétro-ingénierie pour différents composants de circuits intégrés. La liste complète des numéros de pièce de circuits intégrés relevant de notre champ de compétence ne cesse de s'agrandir, veuillez nous contacter pour le savoir.

• Ma vie privée sera-t-elle protégée ?

  Mikatech Innovative Limited comprend l'importance de la vie privée de ses clients. Au moment où vous contactez Mikatech, les informations personnelles vous concernant seront placées sous la protection de nos règles de gestion, élaborées au fil de nos années de pratique. Mikatech utilise ces informations pour personnaliser son service à votre égard, et ne les divulguera jamais à un tiers pour quelque raison que ce soit.
  Pour chaque projet que nous réalisons, nous supprimons toutes les données, matériaux et codes 60 jours après la livraison des fichiers, cela nous protège et protège votre vie privée.

• Est-il légal d'obtenir un service de Mikatech ?

  Oui, c'est tout à fait légal.
  Mikatech fournit ses services de rétro-ingénierie à des fins éducatives uniquement. Il peut être illégal d'utiliser les services mentionnés ci-dessus dans certains pays ou régions, veuillez vérifier vos lois locales. Mikatech n'assume aucune responsabilité quant à l'utilisation des services mentionnés ci-dessus qui pourrait être considérée comme illégale.

  
  
• Je vous ai envoyé un e-mail, pourquoi n'y a-t-il pas de réponse ?

  • A. Notre serveur de messagerie est temporairement en panne, votre message n'a pas été délivré dans notre boîte aux lettres même si le message d'envoi réussi s'affiche à l'écran, veuillez nous contacter à nouveau.
  • B. Notre e-mail est reconnu comme courrier indésirable par votre serveur de messagerie, donc notre réponse a été rejetée par votre serveur ou redirigée vers votre dossier de courriers indésirables, veuillez supprimer notre compte de la liste des indésirables ou vérifier votre dossier de courriers indésirables, ou utiliser un autre compte e-mail pour nous contacter, comme gmail.
  • C. Votre e-mail est reconnu comme courrier indésirable par notre serveur, donc votre e-mail a été placé dans notre dossier de courriers indésirables, veuillez utiliser un autre compte e-mail pour nous contacter à nouveau.

• Extraction de firmware via les ports de débogage

  Les interfaces de débogage comme JTAG et SWD sont essentielles pour le développement, mais ce sont aussi des portes dérobées. Le verrouillage du MCU repose souvent sur l'authentification de débogage. Si l'attaquant peut contourner cette authentification, il peut vider directement la flash et l'EEPROM. La lecture d'un processeur EEPROM est une commande de débogage standard. De nombreux MCU implémentent un mécanisme de verrouillage qui désactive l'accès au débogage. Ce verrou est généralement un bit de fusible. Une fois grillé, l'accès au débogage est définitivement désactivé. Cependant, certains MCU permettent un déverrouillage temporaire via un mot de passe. Le mot de passe est stocké dans une région protégée. L'attaquant peut tenter de forcer le mot de passe par force brute. Ou il peut exploiter une vulnérabilité dans la routine de vérification du mot de passe. Le verrouillage du MCU est vulnérable aux attaques temporelles sur la comparaison de mot de passe. Si la comparaison se termine prématurément en cas de non-concordance, l'attaquant peut deviner octet par octet. Les opérateurs de ransomware LockBit ont utilisé de telles techniques pour déverrouiller des MCU. Ils sondent l'interface de débogage tout en envoyant des mots de passe candidats. Le temps de réponse révèle l'exactitude de chaque octet. Cette méthode évite la décapsulation et la récupération de code. Elle est non destructive. L'attaquant peut également utiliser des perturbations de tension sur le signal d'activation du débogage. Une perturbation peut forcer le MCU à entrer en mode débogage sans authentification. C'est un vecteur d'injection de défaut classique. Une fois le mode débogage actif, l'attaquant peut lire n'importe quel emplacement mémoire. Il peut copier le contenu de la mémoire crypto en émettant des commandes de lecture. Il peut également vider toute la flash. La rétro-ingénierie des microcontrôleurs commence souvent par l'analyse de l'interface de débogage. La première étape consiste à identifier les broches de débogage. Ces broches sont généralement multiplexées avec les GPIO. L'attaquant doit configurer correctement la configuration des broches. Certains MCU ont un chargeur d'amorçage qui active le débogage après une séquence de réinitialisation. La séquence peut impliquer de tirer certaines broches vers le haut ou vers le bas. L'attaquant peut reproduire cette séquence. L'extraction de firmware via le débogage est rapide et fiable. Elle donne une image binaire qui peut être désassemblée. Le verrouillage du MCU est censé empêcher cela. Mais de nombreux développeurs laissent l'interface de débogage ouverte en production. Ils supposent que le bit de verrouillage est suffisant. Cependant, le bit de verrouillage peut être réinitialisé par une commande d'effacement de masse. Certains MCU autorisent l'effacement de masse uniquement si le verrou est activé. Mais si le verrou n'est pas activé, l'effacement de masse n'est pas nécessaire. L'attaquant peut simplement lire. Dans certains MCU, le bit de verrouillage est stocké dans l'EEPROM. La lecture d'un processeur EEPROM pourrait révéler l'état du verrouillage. Mais l'attaquant peut simplement tenter de lire. Si l'accès est refusé, il essaie la perturbation. La combinaison du débogage et des perturbations est puissante. La décapsulation et la récupération de code sont les derniers recours. Le verrouillage du MCU peut également être contourné en exploitant un dépassement de tampon dans le pilote de débogage. Le pilote s'exécute à un niveau de privilège élevé. Si l'attaquant envoie un paquet surdimensionné, il peut écraser l'adresse de retour. Cela redirige l'exécution vers une routine de vidage de mémoire. L'attaquant exécute ensuite cette routine. C'est une attaque logicielle, pas matérielle. Elle contourne complètement le verrouillage. LockBit et d'autres groupes de ransomware ont développé de telles exploits pour les familles de MCU populaires. Ils les partagent dans des forums clandestins. Pour se défendre, les fabricants de MCU doivent durcir leur firmware de débogage. Ils doivent également limiter les commandes de débogage disponibles après authentification. Certains MCU implémentent un protocole de défi-réponse. L'hôte doit prouver qu'il connaît un secret. Ce secret est unique par puce. Sans lui, l'accès au débogage est impossible. Le secret est stocké dans une mémoire OTP (One-Time Programmable). La lecture d'un processeur EEPROM ne peut pas récupérer les bits OTP car ils ne sont pas électriquement lisibles. Ils sont physiquement brûlés. Cependant, l'attaquant peut toujours essayer d'extraire le secret via des canaux auxiliaires. Ou il peut contourner le protocole en perturbant la machine d'état. La machine d'état qui contrôle l'authentification du débogage est souvent simple. Une seule perturbation peut la faire passer de "verrouillé" à "déverrouillé". C'est une vulnérabilité classique. Par conséquent, certains MCU implémentent un coprocesseur de sécurité dédié pour l'authentification du débogage. Ce coprocesseur a son propre verrouillage. Il est durci contre les perturbations. Il inclut également un chien de garde qui réinitialise le système si l'authentification prend trop de temps. Ces mesures élèvent la barre. Mais elles n'éliminent pas la menace. L'attaquant peut toujours utiliser la décapsulation pour lire les bits OTP directement. Ou il peut utiliser la microscopie électronique pour imager les fusibles brûlés. Le verrouillage du MCU est donc un problème à plusieurs niveaux. Chaque niveau a ses propres faiblesses. L'interface de débogage est le niveau le plus accessible. C'est la première cible de nombreux attaquants. Pour le sécuriser, les fabricants devraient désactiver définitivement le débogage en production. C'est la mesure la plus simple et la plus efficace. Cependant, cela empêche les mises à jour sur le terrain et le débogage des pannes sur le terrain. Un compromis consiste à autoriser le débogage uniquement après la présentation d'un jeton physique. Le jeton pourrait être une clé cryptographique stockée dans un élément sécurisé séparé. Le MCU vérifie le jeton via un canal sécurisé. C'est l'approche utilisée dans de nombreux MCU automobiles. La lecture d'un processeur EEPROM n'est pas nécessaire car la clé n'est pas dans le MCU. Vider la flash et l'EEPROM via le débogage devient impossible sans la clé. La décapsulation et la récupération de code ne peuvent pas extraire la clé car elle est externe. Copier le contenu de la mémoire crypto reste possible si le MCU stocke lui-même des clés. Mais ces clés peuvent être chiffrées avec la clé externe. L'attaquant doit donc capturer la clé externe également. Cela augmente la complexité. La rétro-ingénierie des microcontrôleurs de tels systèmes est beaucoup plus difficile. L'extraction de firmware donne uniquement des données chiffrées. L'attaquant doit également rétro-ingénier le protocole du canal sécurisé. C'est une tâche redoutable. En conclusion, les interfaces de débogage sont une vulnérabilité majeure du verrouillage des MCU. Elles permettent un vidage rapide de la flash et de l'EEPROM, la lecture d'un processeur EEPROM, et la copie du contenu de la mémoire crypto. Sans une authentification appropriée, l'extraction de firmware est triviale. L'industrie doit adopter des mécanismes d'authentification robustes et envisager une désactivation permanente pour les produits haute sécurité.